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author | michael-west <michael.west@ettus.com> | 2019-09-24 17:58:13 -0700 |
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committer | Martin Braun <martin.braun@ettus.com> | 2019-10-15 15:21:52 -0700 |
commit | 5c0d0834a4eb1da12940196624f707347395855a (patch) | |
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parent | b2e042963a7c5474ff0492ed2af393b842cf4c59 (diff) | |
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Docs: Adjust FPGA functional verification tests
- Reduce long tests from 3600 seconds to 600 seconds.
- Remove 2xRX@153.6e6 test for N310 10 GbE (not practical).
Signed-off-by: michael-west <michael.west@ettus.com>
Diffstat (limited to 'tools/gr-usrptest')
-rwxr-xr-x | tools/gr-usrptest/apps/usrp_fpga_funcverif.py | 61 |
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diff --git a/tools/gr-usrptest/apps/usrp_fpga_funcverif.py b/tools/gr-usrptest/apps/usrp_fpga_funcverif.py index 50663980b..903808abe 100755 --- a/tools/gr-usrptest/apps/usrp_fpga_funcverif.py +++ b/tools/gr-usrptest/apps/usrp_fpga_funcverif.py @@ -273,9 +273,9 @@ FUNCVERIF_SETTINGS = { {'--rx_rate': 2.4576e6, '--tx_rate': 2.4576e6, 'master_clock_rate': '245.76e6', '--channels': '0,1',}, {'--rx_rate': 2e6, '--tx_rate': 2e6, 'master_clock_rate': '200e6', '--channels': '0,1',}, - {'--rx_rate': 125e6, '--tx_rate': 62.5e6, 'master_clock_rate': '250e6', '--channels': '0,1', '--duration': 3600,}, - {'--rx_rate': 122.88e6, '--tx_rate': 61.44e6, 'master_clock_rate': '245.76e6', '--channels': '0,1', '--duration': 3600,}, - {'--rx_rate': 100e6, '--tx_rate': 66.67e6, 'master_clock_rate': '200e6', '--channels': '0,1', '--duration': 3600,}, + {'--rx_rate': 125e6, '--tx_rate': 62.5e6, 'master_clock_rate': '250e6', '--channels': '0,1', '--duration': 600,}, + {'--rx_rate': 122.88e6, '--tx_rate': 61.44e6, 'master_clock_rate': '245.76e6', '--channels': '0,1', '--duration': 600,}, + {'--rx_rate': 100e6, '--tx_rate': 50e6, 'master_clock_rate': '200e6', '--channels': '0,1', '--duration': 600,}, ], }, 'n310_10gige': { @@ -354,7 +354,6 @@ FUNCVERIF_SETTINGS = { {'--rx_rate': 125e6, 'master_clock_rate': '125e6', '--channels': '0,2',}, {'--rx_rate': 122.88e6, 'master_clock_rate': '122.88e6', '--channels': '0,2',}, - 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