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| author | Michael West <michael.west@ettus.com> | 2013-12-06 17:47:24 -0800 |
|---|---|---|
| committer | Michael West <michael.west@ettus.com> | 2013-12-06 17:47:24 -0800 |
| commit | c3aa7326095a1a8c744e269a04572de74600df8d (patch) | |
| tree | 983711ae9718128617b5f1880f8c6399e38e4055 /images/Makefile | |
| parent | aa3d9a9da0405e84e720870a13718b177d85652c (diff) | |
| parent | 8f0f045cdac16ae84bc446b230beb2b651428294 (diff) | |
| download | uhd-c3aa7326095a1a8c744e269a04572de74600df8d.tar.gz uhd-c3aa7326095a1a8c744e269a04572de74600df8d.tar.bz2 uhd-c3aa7326095a1a8c744e269a04572de74600df8d.zip | |
Merge branch 'master' into mwest_coverity
Conflicts:
host/lib/usrp/b200/b200_iface.cpp
Diffstat (limited to 'images/Makefile')
| -rw-r--r-- | images/Makefile | 16 |
1 files changed, 8 insertions, 8 deletions
diff --git a/images/Makefile b/images/Makefile index 2e3bcfd26..6b1cfcfc4 100644 --- a/images/Makefile +++ b/images/Makefile @@ -117,7 +117,7 @@ $(_usrp_b100_fpga_2rx_bin): $(GLOBAL_DEPS) endif ######################################################################## -# USRP2 and N Series firmware +# USRP2 and N-Series firmware ######################################################################## ifdef HAS_ZPU_GCC @@ -143,7 +143,7 @@ $(_usrp_n210_fw_bin): $(_usrp2_fw_bin) endif ######################################################################## -# USRP2 fpga +# USRP2 FPGA ######################################################################## ifdef HAS_XTCLSH @@ -159,7 +159,7 @@ $(_usrp2_fpga_bin): $(GLOBAL_DEPS) endif ######################################################################## -# USRP-N200 R2/R3 fpga +# USRP N200 R2/R3 FPGA ######################################################################## ifdef HAS_XTCLSH @@ -185,7 +185,7 @@ $(_usrp_n200_r2_fpga_bin): $(_usrp_n200_r3_fpga_bin) endif ######################################################################## -# USRP-N210 R2/R3 fpga +# USRP N210 R2/R3 FPGA ######################################################################## ifdef HAS_XTCLSH @@ -211,7 +211,7 @@ $(_usrp_n210_r2_fpga_bin): $(_usrp_n210_r3_fpga_bin) endif ######################################################################## -# USRP-N200 R4 fpga +# USRP N200 R4 FPGA ######################################################################## ifdef HAS_XTCLSH @@ -231,7 +231,7 @@ $(_usrp_n200_r4_fpga_bit): $(_usrp_n200_r4_fpga_bin) endif ######################################################################## -# USRP-N210 R4 fpga +# USRP N210 R4 FPGA ######################################################################## ifdef HAS_XTCLSH @@ -251,7 +251,7 @@ $(_usrp_n210_r4_fpga_bit): $(_usrp_n210_r4_fpga_bin) endif ######################################################################## -# USRP-E100 fpga +# USRP E100 FPGA ######################################################################## ifdef HAS_XTCLSH @@ -267,7 +267,7 @@ $(_usrp_e100_fpga_bin): $(GLOBAL_DEPS) endif ######################################################################## -# USRP-E110 fpga +# USRP E110 FPGA ######################################################################## ifdef HAS_XTCLSH |